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986 B
Systemverilog
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986 B
Systemverilog
package cpu_pkg;
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//
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// 4 | ST0_ADDR -> ST1_DEC -> ST2_EXEC -> ST3_NOP
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// 12 | '-> ST2_DEC -> ST3_DEC -> ST4_EXEC -> .... -> ST11_NOP
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//
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typedef enum {
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ST0_ADDR,
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ST1_DEC,
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ST2_EXEC,
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ST2_DEC,
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ST3_DEC,
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ST4_EXEC
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} state_t;
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typedef enum logic [2:0] {
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REG8_B = 3'h00,
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REG8_C = 3'h01,
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REG8_D = 3'h02,
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REG8_E = 3'h03,
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REG8_H = 3'h04,
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REG8_L = 3'h05
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} reg8_t;
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typedef enum logic [2:0] {
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ALU_OP_ADD = 3'h00,
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ALU_OP_ADC = 3'h01,
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ALU_OP_SUB = 3'h02,
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ALU_OP_SBC = 3'h03,
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ALU_OP_AND = 3'h04,
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ALU_OP_XOR = 3'h05,
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ALU_OP_OR = 3'h06,
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ALU_OP_CP = 3'h07
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} alu_op_t;
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typedef enum {
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OP_SRC_A,
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OP_SRC_REG8
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} op_src_t;
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typedef enum {
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OP_DEST_A
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} op_dest_t;
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typedef enum {
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SP_SRC_OPERAND16
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} sp_src_t;
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endpackage
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